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ファイル	フォーマット	サイズ	閲覧回数	利用開始日	説明
IEICE_E84-D_5_635	pdf	1.93 MB	74	2014.04.03

論文情報

タイトル	Error Models and Fault-Secure Scheduling in Multiprocessor Systems
著者	NRID 1000080305309 1000080305309 著者名 Hashimoto, Koji
	NRID 1000030283740 1000030283740 著者名 Tsuchiya, Tatsuhiro
	NRID 1000050093745 1000050093745 著者名 Kikuno, Tohru
キーワード等	multiprocessors
	fault-secure scheduling
	task graphs
	error models
	tests
出版者	電子情報通信学会
	The Institute of Electronics, Information and Communication Engineers
	デンシ　ジョウホウ　ツウシン　ガッカイ
収録物名	IEICE transactions on information and systems
巻	E84-D
号	5
開始ページ	635
終了ページ	650
刊行年月	2001-05-01
言語	英語
ハンドルURL	https://hdl.handle.net/11094/27256
ISSN	09168532
NCID	AA10826272
関連情報 (references)	関連識別子 http://search.ieice.org/
アクセス権	open access
権利情報	Copyright © 2001 The Institute of Electronics, Information and Communication Engineers
出版タイプ	Version of Record
カテゴリ	学術雑誌論文 Journal Article

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