CPUの高位設計の自動検証システムの作成と学生実験への適用

北濱, 優子; 北嶋, 暁; 岡野, 浩三 他

情報処理学会シンポジウムシリーズ（DAシンポジウム論文集）, 1998, 98(9), 101-106

Number of Access:886（2025-08-31 18:56 Counts）

Identifier to cite or link to this item: https://hdl.handle.net/11094/51037

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ipsj_DA_1998 pdf None 449 KB 85 2015.01.07 出版社版/publisher  

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Title
CPUの高位設計の自動検証システムの作成と学生実験への適用
CPU　ノ　コウイ　セッケイ　ノ　ジドウ　ケンショウ　システム　ノ　サクセイ　ト　ガクセイ　ジッケン　ヘノ　テキヨウ
Creator
CreatorName
北濱, 優子
NRID
1000000304030 1000000304030
CreatorName
北嶋, 暁
NRID
1000070252632 1000070252632
CreatorName
岡野, 浩三
NRID
1000080173144 1000080173144
researchmap permalink
teruo.higashino teruo.higashino
Scopus Author ID
7005648670 7005648670
CreatorName
東野, 輝夫
NRID
1000000029513 1000000029513
CreatorName
谷口, 健一
Abstract
大阪大学情報工学科の3年次学生のCPU設計実験において一部、高位設計用の自動検証システムを導入した。自動検証システムは(1)命令セットアーキテクチャと、制御部を一状態機械で表したRTレベルの仕様に対して、後者が前者の正しい詳細化であることを証明するツールと、(2)複数状態機械で表した制御部の生成する入出力信号が(1)の制御部のものと等価であることを証明するツールの2つからなる。自動検証すシステムを用いたグループと用いなかったグループの設計作業時間の比較等について報告する。
In this report, we present an experiment result in laboratory work of designing 16-bit CPUs for undergraduate students. A half of students use the following two verifiers to design 16-bit CPUs: (1) a verifier which checks the correctness of refinement between an instruction set architecture level’s specification and its RT level’s one, and (2) a verifier which checks the equivalence of I/O values between the controller of the RT level specification consisting of a single state machine and its refined controller consisting of multiple state machines. A comparison between groups using verifiers and groups not using verifiers is given.
Publisher
情報処理学会
ジョウホウ　ショリ　ガッカイ
Source Title
情報処理学会シンポジウムシリーズ（DAシンポジウム論文集）
Volume (Issue)
98(9)
Page
101-106
Date of Issued
1998-07
Language
Japanese
Handle URL
https://hdl.handle.net/11094/51037
Access Rights
open access
CopyRight
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